《数字逻辑电路》期末考试

这篇具有很好参考价值的文章主要介绍了《数字逻辑电路》期末考试。希望对大家有所帮助。如果存在错误或未考虑完全的地方,请大家不吝赐教,您也可以点击"举报违法"按钮提交疑问。

一、单项选择题(每小题 2 分,共 30 分)
1 、与八进制数 (24.4)8 对应的二进制数是( )。
A (10101.1) 2
B (10110.1) 2
C (10100.1) 2
D (11011.01) 2
2 .将 (01000011.00101000) 5421BCD 转换为八进制数为( )。
A (43.25) 8
B (53.2) 8
C (35.25) 8
D (56.5) 8
3 、若输入变量 A B 只有全为 1 时,输出 F=0 ,则其输入与输出的关系是( )。
A .异或
B .同或
C .或非
D .与非
4 、逻辑电路如图 1.1 所示,其输出函数 F 为( )。
《数字逻辑电路》期末考试
A C=0 F =   A =   B C=1 F  =   AB
B C=0 F  =    0   C=1   F   1
C C=0 F =   A =   B C=1 F AB
D F = AB = C =   ( A = B ) C
5 、逻辑函数用卡诺图化简时,八个逻辑相邻项合并可消去( )。
A .一个变量
B .二个变量
C .三个变量
D .四个变量
6 F =   AB BC 的最小项表达式是( )。
A F =   (0,2,3,4) B F =   (1,5,6,7)
C F =   (0,1,4,6) D F =   (2,3,5,7)
7 、逻辑函数 F = ( AB + AB ) + ( A Å B ) 的最简与或式为( )。
A A + B
B A + B
C A + B
D. 1
8 、逻辑函数 F ( A , B , C , D ) = å m (0,1,2,4,6,7,8,9,10,12,14) 的最简与非式为
( )。
A B × C × BD × BD × ABC
B D × B × C × ABC
C D × BC × ABC
D D × BC × AB × C
9 、某函数的反函数是 F A B AC BD ,其原函数为( )。
A F =   ( A +   B ) A +   C ( B +   D )
B F =   ( A +   B ) A +   C ( B +   D )
C F =   ( A +   B ) +   A +   C ( B +   D )
D F =   ( A +   B ) A +   CB +   D
10 、函数 F ( ABCD ) = AC . D +   AB . C +   A.   BC +   ACD 约束条件 BD =   0 的最简与或
式为( )。
A  =  AC +   AC       B F =   ACD +   ABC +   ABC +   ABC
C F =   AC +   AC       D F =   BC +   BC
11 、在下列逻辑电路中,属于组合逻辑电路的是( )。
A .寄存器 B .编码器 C .触发器 D .计数器
12、所谓同步计数器是指( )。
A.各触发器的时钟端连在一起,统一由系统时钟控制
B.可用前级的输出做后级触发器的时钟
C.由同类型的触发器构成
D .可用后级的输出做前级触发器的时钟
13 、为使 JK 触发器的状态由 0 0 ,其激励端 JK 取值为( )。
A x0 B 0X C x1 D 1x
14、四位移位寄存器现态为 1101 ,左移进两个 0 后再右移进一个 1 。其移位寄存器的状
态是( )。
A.0110
B.0111
C.0100
D .1010
15 74 LS 161 C r = 1; LD =   0; P = 1; T =  1 。其功能是( )。
A.计数 B.预置数 C.清零 D.保持
二、填空题
16 、开路门输出并联完成 _______ 逻辑功能。
17、一个自然二进制码为 1110,该格雷码是 。
18、F=A Å 0 Å A Å 1 Å 0 Å 1=________________。
19 、时序电路的输出与当前输入有关,与电路过去状态 ________________
20 150KHZ 输入信号,其分频的分频系数为 3 ,输出频率为 ____________
三、分析题
说明:中规模器件 74LS90 74LS161 74LS194 的功能见附页
21 、由双 4 1 数据选择器组成电路如图 3.1 所示。
①写出输出函数 F 1 F 2 表达式;
②列出真值表;
③说明其功能。
《数字逻辑电路》期末考试
22 .电路如图 3.2 所示。
①分别列出图所示电路的状态迁移关系;
②分别指出电路的功能。
《数字逻辑电路》期末考试
23 、由四选一数据选择器和移位寄存器 74LS194 组成电路如图 3.3 所示。
①列出 74LS194 的状态迁移关系;
②写出输出 F 的序列信号。
《数字逻辑电路》期末考试

 四、设计题

24、用 74LS138 译码器和少量的门电路设计一个转换电路,将输入的三位格雷码 G2G1G0
转换为三位二进制 B2B1B0。
①列出真值表;
②画出逻辑图。
25、试用 74LS161 设计一个起始态为 0100 的 9 进制计数器。
①列出状态迁移表;
②画出逻辑电路图。
《数字逻辑电路》期末考试
26 、利用 JK 触发器设计同步三进制加法计数器。
①做出状态迁移表;
②确定每级触发器的激励函数;
③画出逻辑图。
《数字逻辑电路》期末考试
《数字逻辑电路》期末考试

《数字逻辑电路》期末考试

 文章来源地址https://www.toymoban.com/news/detail-496474.html

到了这里,关于《数字逻辑电路》期末考试的文章就介绍完了。如果您还想了解更多内容,请在右上角搜索TOY模板网以前的文章或继续浏览下面的相关文章,希望大家以后多多支持TOY模板网!

本文来自互联网用户投稿,该文观点仅代表作者本人,不代表本站立场。本站仅提供信息存储空间服务,不拥有所有权,不承担相关法律责任。如若转载,请注明出处: 如若内容造成侵权/违法违规/事实不符,请点击违法举报进行投诉反馈,一经查实,立即删除!

领支付宝红包 赞助服务器费用

相关文章

  • 时序逻辑电路一——数字逻辑实验

    (1)熟悉触发器的逻辑功能及特性。 (2)掌握集成D和JK触发器的应用。 (3)掌握时序逻辑电路的分析和设计方法。 用D触发器(74LS74)组成二分频器、四分频器 74LS74是双D触发器(上升沿触发的D触发器),其管脚图和功能表如下: 每个74LS74芯片有两个D触发器,每个D触发器

    2024年02月06日
    浏览(41)
  • 组合逻辑电路二——数字逻辑实验

    (1)掌握数据选择器和译码器的功能。 (2)用数据选择器实验逻辑函数。 (3)用译码器实现逻辑函数。 (一)74LS151 74LS151是常用的8选1数据选择器,芯片内部有一个8选1数据选择器。通过输入不同的地址码C、B、A,可以控制输出Y选择8个输入数据D0~D7中的一个。 连线图和

    2023年04月26日
    浏览(45)
  • spark期末考试选择题精选

    以下哪一个不是saprk的特点 A、随处运行 B、代码简洁 C、使用复杂 D、运行快速 Scala属于哪种编程语言 A、函数式编程语言 B、汇编语言 C、机器语言 D、多范式编程语言 以下哪种不属于的特性? A、命令式编程 B、函数式编程 C、静态类型 D、不可扩展性 以下哪种可以正确计算数

    2024年02月07日
    浏览(42)
  • 物联网期末考试复习题(选择判断题)

    一、选择题 1.以下不属于物联网的主要特征的是(A) A.速度快  B.实时性  C.自动化  D.大范围 2摄像头属于物联网的哪个层(A) A.感知层  B.网络层  C.业务层  D.应用层 3.2009年8月7日温家宝总理在江苏无锡调研时提出下面哪个概念(C) A感受中国 B.感应中国 C.感知中国 

    2024年02月12日
    浏览(47)
  • C++期末考试选择题题库100道

    1. 对于常数据成员,下面描述正确的是 【 B 】 A. 常数据成员必须被初始化,并且不能被修改 B. 常数据成员可以不初始化,并且不能被修改 C. 常数据成员可以不初始化,并且可以被修改 D. 常数据成员必须被初始化,并且可以被修改 2. 在C++中,使用流进行输入输出,其中用于

    2023年04月17日
    浏览(49)
  • 数字逻辑基础实验二—时序逻辑电路的设计

    实验目的 (1)掌握中规模集成寄存器构成的时序逻辑电路的设计方法。 (2)掌握中规模集成计数器设计N进制计数器的方法。 (3)学会用时序功能器件构成综合型应用电路。 实验电路 图 2-1红绿灯电路 实验软件与环境 软件  Multisim 14.2 环境  Windows 11 专业版21H2 设备名称 

    2023年04月21日
    浏览(45)
  • 组合逻辑电路设计---多路选择器

    目录 1、多路选择器简介 2、硬件设计 3、实验任务 4、程序设计 4.1、模块设计 4.2、绘制波形图 4.3、编写代码 (1)assign 中条件运算符(三目运算符)实现方法: (2)always 语句块中使用 if-else 实现方法: (3)always 语句块中使用 case 语句的方法: 4.4、仿真验证 4.4.1、编写

    2024年02月11日
    浏览(37)
  • 组合逻辑、时序逻辑的适用场合、数字逻辑电路的时序分析

    组合逻辑: 组合逻辑是一类逻辑电路,其输出仅仅取决于当前的输入信号状态,而不考虑过去的信号状态。 组合逻辑电路的输出完全由输入决定,没有时钟信号的概念,因此输出是输入的函数。 例子包括逻辑门(AND、OR、NOT等)和其他不带存储元件(如触发器)的电路。 时

    2024年02月03日
    浏览(44)
  • 数字逻辑电路设计课程设计

    1、学会应用数字系统设计方法进行电路设计; 2、进一步提高quartus II软件的开发应用能力; 3、提高VHDL进行综合设计的能力; 4、培养学生书写综合实验报告的能力。 1、设计平台:quartus II+HH-SOPC-EP1C12 EDA/SOPC实验开发平台 2、设计方法:利用VHDL代码和/或原理图方法,采用层次

    2024年02月01日
    浏览(86)
  • 数字电路和模拟电路-6组合逻辑模块及其应用(上)

    前言:结合之前学习的基本门电路、逻辑电路的分析与设计,去剖析解编码器、译码器、数据选择器、加法器、数值比较器的模块设计与应用。 目录 一、编码器 1、工作原理 2、编码器-74LS148分析 3、应用74LS148接成16线—4线优先编码器 二、译码器 1、译码器定义 2、74145译码器分

    2024年02月04日
    浏览(44)

觉得文章有用就打赏一下文章作者

支付宝扫一扫打赏

博客赞助

微信扫一扫打赏

请作者喝杯咖啡吧~博客赞助

支付宝扫一扫领取红包,优惠每天领

二维码1

领取红包

二维码2

领红包