Error (10663): Verilog HDL Port Connection error at rom_ctrl.v(64): output or inout port “q“ must be

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Error (10663): Verilog HDL Port Connection error at rom_ctrl.v(64): output or inout port “q“ must be

 Error (10663): Verilog HDL Port Connection error at rom_ctrl.v(64): output or inout port “q“ must be

Error (10663): Verilog HDL Port Connection error at rom_ctrl.v(64): output or inout port “q“ must be 

 原因:连接模块端口的中间变量应该使用wire类型,而不是reg类型文章来源地址https://www.toymoban.com/news/detail-514381.html

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