FPGA学习笔记 1 -- Quartus软件的使用

这篇具有很好参考价值的文章主要介绍了FPGA学习笔记 1 -- Quartus软件的使用。希望对大家有所帮助。如果存在错误或未考虑完全的地方,请大家不吝赐教,您也可以点击"举报违法"按钮提交疑问。


一、FPGA开发流程

打开软件→新建工程→设计输入(verilog代码)→配置工程(I/O引脚复用)→分析与综合(对设计输入进行分析,检查是否有语法错误)→分配引脚(根据原理图分配)→编译工程(生成sof文件)→下载程序

二、Quartus II 13.1软件

1.新建工程

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2.添加设计文件

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3.分析与综合

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4.分配引脚

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找到工程路劲下的.qsf文件,直接添加或修改引脚
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创建一个tcl文件,里面写好引脚配置,再添加到工程
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5.编译工程

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6.下载

有两种下载方式,sof文件和jic文件下载,sof是下载到FPGA芯片里面执行的,断电重启后就不执行了,jic文件是下载FPGA flash里面,断电重启后会执行。
sof文件下载
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jic文件下载
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现象

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