[HDLBits] Alwaysblock2

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Build an XOR gate three ways, using an assign statement, a combinational always block, and a clocked always block. Note that the clocked always block produces a different circuit from the other two: There is a flip-flop so the output is delayed.

[HDLBits] Alwaysblock2,HDLBits,fpga开发,verilog,fpga

// synthesis verilog_input_version verilog_2001
module top_module(
    input clk,
    input a,
    input b,
    output wire out_assign,
    output reg out_always_comb,
    output reg out_always_ff   );
	assign out_assign=a^b;
    always@(*) begin
        out_always_comb=a^b;
    end
    always@(posedge clk) begin
        out_always_ff<=a^b;
    end
endmodule

 文章来源地址https://www.toymoban.com/news/detail-636856.html

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