[HDLBits] Dff8p

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  2024年02月16日

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  Verilog刷题[hdlbits] ：Module add

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  HDLBits-Verilog学习记录 | Verilog Language-Modules（1）

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  2024年02月11日

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  就是用代码来描述硬件结构 语言有VHDL与Verilog HDL Verilog HDL 是从C语言来的，学的快 ###例子 也叫保留字，一般是小写 module 表示模块的开始 endmodule 模块的结束 模块名 一般与.v文件的名字一致 输入信号 input 输出信号 output 既做输入也做输出 inout 需要一些变量和参数对输

  2024年02月21日

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  目录   写在前面 Basics Simple wire  Four wires  Inverter  AND gate  NOR gate  Declaring wires  7485 chip HDLBits 作为 Verilog 的刷题网站，非常适合初学者拿来练习，不仅可以学到基础的语法，还可以让自己写出的代码更直观，直接映射到电路中，因此在这段时间每周会抽出一点时间来把这个

  2024年02月10日

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  目录 写在前面 Vectors Vector0 Vector1 Vector2 Vectorgates Gates4 Vector3 Vectorr  Vector4 Vector5 来到了 Verilog 语法的矢量部分，这部分仍然比较简单，所以只给出题目、代码和仿真结果，其他不多赘述。 构建一个具有一个3位输入的电路，然后输出相同的矢量，并将其拆分为三个单独的1位输

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  hdlbits系列verilog解答（always块if语句）-31

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  2024年02月12日

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