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提高Xilinx FPGA Flash下载速度

10月前 作者：FPGA技术实战 分类：Toy博客 阅读(58) 违法举报

这篇具有很好参考价值的文章主要介绍了提高Xilinx FPGA Flash下载速度。希望对大家有所帮助。如果存在错误或未考虑完全的地方，请大家不吝赐教，您也可以点击"举报违法"按钮提交疑问。

最近在编写完FPGA逻辑，成功生成.bin文件后，可以通过Vivado软件进行设置，提高烧写速度。操作如下：

（1）布局布线完成后，点击Open Implementation。

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（2）点击Tool-----> Edit Device Properties...

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（3）General ----->Enable Bitstream Compression ----->TRUE，选择压缩数据流，提高下载速度。

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（4）Configuration -------> Configuration Rate(MHz)，可以选择较大的CCLK时钟值。（如果配置I/O PCB布线不佳，较大的时钟可能会导致FLASH烧写失败，此时需要降低CCLK时钟）

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点击OK，并点击“保存”菜单，保存当前配置。

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打开.xdc约束文件，我们可以看到新增以下内容：

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完成以上操作，重新生成bit文件及bin文件即可实现加快FLASH烧写速度。

欢迎关注FPGA技术实战公众号，喜欢就多多转发吧！文章来源地址https://www.toymoban.com/news/detail-776582.html

到了这里，关于提高Xilinx FPGA Flash下载速度的文章就介绍完了。如果您还想了解更多内容，请在右上角搜索TOY模板网以前的文章或继续浏览下面的相关文章，希望大家以后多多支持TOY模板网！

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