Vivado工程创建、仿真、下载与固化全流程

这篇具有很好参考价值的文章主要介绍了Vivado工程创建、仿真、下载与固化全流程。希望对大家有所帮助。如果存在错误或未考虑完全的地方,请大家不吝赐教,您也可以点击"举报违法"按钮提交疑问。

本文以一个简单工程为例,介绍使用Vivado新建工程、代码的编写、Testbench代码的编写、波形仿真分析、引脚约束、生成bit流文件、通过JTAG将网表下载到开发板、程序的固化与下载全流程。

1.新建工程

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2.RTL代码的编写

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3.Testbench的原理

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4.Testbench代码的编写

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5.打开SIMULATION观察波形

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6.仿真波形分析

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7.引脚约束

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8.生成bit流文件

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9.通过JTAG将网表下载到开发板

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10.程序的固化

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10.1 MCS文件的生成

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10.2 BIN文件的生成

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10.3 下载固化文件

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参考文献

选自 野火《FPGA Verilog开发实战指南——基于Xilinx Artix7》文章来源地址https://www.toymoban.com/news/detail-786561.html

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