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1.首先需要用一个数字IO的输入FPGA端口，并将其拖入程序框图中，同时创建一个循环。
2.如果想要在循环中实现累加功能，就可以使用移位寄存器。
数字输入的当前值和历史值进行比较，用于一个判断大于，来确定是否出现了上升沿。
同时如果想确认上升沿的次数也可以用移位寄存器，如果出现上升沿则计数加1，否则保持原值。
1.使用IO的方法节点，FPGA I/O方法节点检测到边沿后，程序框图的计数器值加1，且将计数器的值存储在While循环的移位寄存器内。使用前面板显示控件或局部变量可查看计数器的值。
文章来源：https://www.toymoban.com/news/detail-809739.html
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clk为模拟的脉冲，reset为重置信号，如果reset为0，则把init的值作为初始值赋值给out，enable为使能端，如果enable为1，则在上升沿根据mode的值，如果mode为1，为加计数，mode为0，为减计数。 仿真图像中， 第1个脉冲，reset为0，为out赋值输入的初始值0010。 第2~6个脉冲，enable为1，
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