基于FPGA的HDMI视频接口设计

这篇具有很好参考价值的文章主要介绍了基于FPGA的HDMI视频接口设计。希望对大家有所帮助。如果存在错误或未考虑完全的地方,请大家不吝赐教,您也可以点击"举报违法"按钮提交疑问。

HDMI介绍

        HDMI(High-DefinitionMultimedia Interface)又被称为高清晰度多媒体接口,是首个支持在单线缆上传输,不经过压缩的全数字高清晰度、多声道音频和智能格式与控制命令数据的数字接口。HDMI接口由Silicon Image美国晶像公司倡导,联合索尼、日立、松下、飞利浦、汤姆逊、东芝等八家著名的消费类电子制造商联合成立的工作组共同开发的。

HDMI传输原理

         HDMI采用TMDS (TimeMinimized Differential Signal)最小化传输差分信号传输技术 , TMDS是一种微分信号机制,采用的是差分传动方式 ,是一种利用2个引脚间电压差来传送信号的技术。每一个标准的HDMI连接,都包含了3个用于传输数据的TMDS传输通道,还有1个独立的TMDS时钟通道,以保证传输时所需的统一时序。在一个时钟周期内,每个TMDS通道都能传送10bit的数据流。而这10bit数据,可以由若干种不同的编码格式构成。

TMDS的原理

每一个 TMDS 链路都包括 3 个传输 RGB 信号的数据通道和 1 个传输时钟信号的通道。每一个数据通道都通过编码算法,将 8 位的视、音频数据转换成最小化传输、直流平衡的 10 位数据。这使得数据的传输和恢复更加可靠。小化传输差分信号是通过异或及异或非等逻辑算法将原始 8 位信号数据转换成 10 位,前 8 为数据由原始信号经运算后获得,第 9 位指示运算的方式,第 10 位用来对应直流平衡。

一般来说,HDMI 传输的编码格式中要包含视频数据、控制数据和数据包(数据包中包含音频数据和附加信息数据,例如纠错码等)。TMDS 每个通道在传输时要包含一个 2bit 的控制数据、8bit 的视频数据或者 4bit 的数据包即可。在 HDMI 信息传输过程中,可以分为三个阶段:视频数据传输周期、控制数据传输周期和数据岛传输周期,分别对应上述的三种数据类型如下图所示。

基于FPGA的HDMI视频接口设计,FPGA学习,fpga开发

HDMI的特点 

1、更好的抗干扰性能,能实现最长20米的无增益传输。

2、针对大尺寸数字平板电视分辨率进行优化,兼容性好。

3、支持EDID(注1)和DDC2B(注2)标准,设备之间可以智能选择最佳匹配的连接方式。

4、拥有强大的版权保护机制(HDCP),有效防止盗版现象。

5、支持24bit色深处理,(RGB、YCbCr4-4-4、YCbCr4-2-2)。

6、接口体积小,各种设备都能轻松安装。

7、一根线缆实现数字音频、视频信号同步传输,有效降低使用成本和繁杂程度。

8、完全兼容DVI接口标准,用户不用担心新旧系统不匹配。

9、支持热插拔技术。

HDMI的接口类型 

 常见的HDMI类型有A、B、C三种类型。其中A型是标准的19针HDMI接口,普及率最高;B型接口尺寸稍大,但是有29个引脚,可以提供双TMDS传输通道。而C型接口和A型接口性能一致,但是体积较小,更加适合紧凑型便携设备使用。接口A、接口B、接口C,如下图所示。

基于FPGA的HDMI视频接口设计,FPGA学习,fpga开发

 HDMI的数据发送系统程序设计

基于FPGA的HDMI视频接口设计,FPGA学习,fpga开发

 该系统设计主要由上图几部分组成,分别是时钟模块、HDMI控制模块、图像数据模块,DVI数据输出编码模块。

 时钟模块设计

  该模块的作用就是产生图像的像素时钟pixel_clk和串化时钟serial_clk,这里调用Xilinx官方的IP实现功能。

 HDMI_control模块设计

 根据HDMI支持的VGA图像分辨率,输出对应的视频帧行信号。

一行数据包括:Hor Sync(行同步)、Hor Back Porch(行消隐)、Hor Active Video(行规频有效)和 Hor Front Porch(行前肩),VGA的行信号时序图如下图所示。

基于FPGA的HDMI视频接口设计,FPGA学习,fpga开发一场数据包括:Ver Sync(场同步)、Ver Back Porch(场消隐)、Ver Active Video(场规频有效)和 Ver Front Porch(场前肩),VGA的场信号时序图如下图所示。基于FPGA的HDMI视频接口设计,FPGA学习,fpga开发 

 VGA 时序主要分为行时序场时序,行时序是以像素为单位,场时序是以行为单位。VGA 行时序对行同步时间、消隐时间、行规频有效时间行前肩时间有特定要求,列时序也是如此,如果其中一部分时序出现问题就会造成显示出现问题列举部分常用 VGA 分辨率时序参数如下表所示

  • 1. HDMI支持的分辨率参数

显示模式

时钟

行时序参数(单位:pixel)

场时序参数(单位:行)

a

b

c

d

e

f

g

h

i

k

640*480@60HZ

25.175

96

48

640

16

800

2

33

480

10

525

800*600@60HZ

40

128

88

800

40

1056

4

23

600

1

623

1024*768*60HZ

65

136

160

1024

24

1344

6

29

768

3

806

1280*720*60HZ

74.25

40

220

1280

110

1650

5

20

720

5

750

1280*1024*60HZ

108

112

248

1280

48

1688

3

38

1024

1

1066

1920*1080*60HZ

148.5

44

148

1920

88

2200

5

36

1080

4

1125

1920*1080*30HZ

74.25

44

148

1920

88

2200

5

36

1080

4

1125

  • 1. HDMI_control程序接口

名称

方向

位宽

说明

clk

I

1

工作时钟

rst

I

1

复位信号(active high)

vs

O

1

输出的场信号 (active high or low 可以设置)

hs

O

1

输出的行信号 (active high or low 可以设置)

de

O

1

输出的有效数据信号(active high)

该模块程序根据根据VGA的帧行信号的参数来设计,这里选用1920*1080*60HZ作为例子进行讲解,该模块的程序代码如下所示。

基于FPGA的HDMI视频接口设计,FPGA学习,fpga开发基于FPGA的HDMI视频接口设计,FPGA学习,fpga开发基于FPGA的HDMI视频接口设计,FPGA学习,fpga开发基于FPGA的HDMI视频接口设计,FPGA学习,fpga开发基于FPGA的HDMI视频接口设计,FPGA学习,fpga开发基于FPGA的HDMI视频接口设计,FPGA学习,fpga开发基于FPGA的HDMI视频接口设计,FPGA学习,fpga开发基于FPGA的HDMI视频接口设计,FPGA学习,fpga开发基于FPGA的HDMI视频接口设计,FPGA学习,fpga开发如上图所示,VS信号(场信号)正常,这里设置VS信号是低电平有效,按照设置的1920*1080@60HZ的帧信号参数输出 

基于FPGA的HDMI视频接口设计,FPGA学习,fpga开发

如上图所示,HS信号(场信号)正常,这里设置HS信号是低电平有效,按照设置的1920*1080@60HZ的帧信号参数输出;

如上图所示,de信号(场信号)正常,这里设置de信号是高电平有效,按照设置的1920*1080@60HZ的帧信号参数输出。

基于FPGA的HDMI的方块移动演示-CSDN直播文章来源地址https://www.toymoban.com/news/detail-855719.html

到了这里,关于基于FPGA的HDMI视频接口设计的文章就介绍完了。如果您还想了解更多内容,请在右上角搜索TOY模板网以前的文章或继续浏览下面的相关文章,希望大家以后多多支持TOY模板网!

本文来自互联网用户投稿,该文观点仅代表作者本人,不代表本站立场。本站仅提供信息存储空间服务,不拥有所有权,不承担相关法律责任。如若转载,请注明出处: 如若内容造成侵权/违法违规/事实不符,请点击违法举报进行投诉反馈,一经查实,立即删除!

领支付宝红包 赞助服务器费用

相关文章

  • FPGA实现HDMI接口

    HDMI( High-Definition Multimedia Interface),即高清多媒体接口。它能够 同时传输视频和音频 ,简化了设备的接口和连线;同时提供了更高的数据传输带宽, 可以传输无压缩的数字音频及高分辨率视频信号。 HDMI 接口在物理层使用 TMDS 标准传输音视频数据。 点亮液晶显示屏需要按

    2024年02月04日
    浏览(41)
  • FPGA高端项目:解码索尼IMX327 MIPI相机+图像缩放+视频拼接+HDMI输出,提供开发板+工程源码+技术支持

    FPGA高端项目:解码索尼IMX327 MIPI相机+图像缩放+视频拼接+HDMI输出,提供开发板+工程源码+技术支持 FPGA图像采集领域目前协议最复杂、技术难度最高之一的应该就是MIPI协议了,MIPI解码难度之高,令无数英雄竞折腰,以至于Xilinx官方不得不推出专用的IP核供开发者使用,不然太

    2024年04月08日
    浏览(56)
  • FPGA基于XDMA实现PCIE X4视频采集HDMI输出 提供工程源码和QT上位机程序和技术支持

    PCIE(PCI Express)采用了目前业内流行的点对点串行连接,比起 PCI 以及更早期的计算机总线的共享并行架构,每个设备都有自己的专用连接,不需要向整个总线请求带宽,而且可以把数据传输率提高到一个很高的频率,达到 PCI 所不能提供的高带宽,是目前各行业高速接口的优

    2024年02月02日
    浏览(46)
  • FPGA基于XDMA实现PCIE X8视频采集HDMI输出 提供工程源码和QT上位机程序和技术支持

    PCIE(PCI Express)采用了目前业内流行的点对点串行连接,比起 PCI 以及更早期的计算机总线的共享并行架构,每个设备都有自己的专用连接,不需要向整个总线请求带宽,而且可以把数据传输率提高到一个很高的频率,达到 PCI 所不能提供的高带宽,是目前各行业高速接口的优

    2024年02月01日
    浏览(44)
  • FPGA基于XDMA实现PCIE X8的HDMI视频采集 提供工程源码和QT上位机程序和技术支持

    PCIE(PCI Express)采用了目前业内流行的点对点串行连接,比起 PCI 以及更早期的计算机总线的共享并行架构,每个设备都有自己的专用连接,不需要向整个总线请求带宽,而且可以把数据传输率提高到一个很高的频率,达到 PCI 所不能提供的高带宽,是目前各行业高速接口的优

    2024年02月04日
    浏览(39)
  • FPGA基于XDMA实现PCIE X4的HDMI视频采集 提供工程源码和QT上位机程序和技术支持

    PCIE(PCI Express)采用了目前业内流行的点对点串行连接,比起 PCI 以及更早期的计算机总线的共享并行架构,每个设备都有自己的专用连接,不需要向整个总线请求带宽,而且可以把数据传输率提高到一个很高的频率,达到 PCI 所不能提供的高带宽,是目前各行业高速接口的优

    2023年04月18日
    浏览(43)
  • FPGA实现USB3.0 UVC 相机HDMI视频输出 基于FT602驱动 提供工程源码和QT上位机源码

    目前USB3.0的实现方案很多,但就简单好用的角度而言,FT601/602应该是最佳方案,因为它电路设计简单,操作时序简单,软件驱动简单,官方甚至提供了包括FPGA驱动在内的丰富的驱动源码和测试软件; 本设计用FPGA驱动FT602芯片实现USB3.0UVC 相机彩条视频输出试验,使用同步245模

    2024年02月03日
    浏览(49)
  • FPGA高端图像处理开发板-->鲲叔4EV:12G-SDI、4K HDMI2.0、MIPI等接口谁敢与我争锋?

    在CSDN写博客传播FPGA开发经验已经一年多了,帮助了不少人,也得罪了不少人,有的人用我的代码赢得了某些比赛、得到了心仪的offer,也有的人天天骂我,anyway,哪怕只要还能帮助一个即将毕业的学生找到工作,哪怕只要还能帮助一个工程师解决项目开发的燃眉之急,我做的

    2024年04月16日
    浏览(60)
  • 基于FPGA的视频接口之SDI编码

    SDI接口是一种“数字分量串行接口”,对于详细解释,可以在Google下SDI,我就不当网络的搬运工了,划重点的是,SDI常见的分为3种模式,即SD-SDI、HD-SDI和3G-SDI,以及升级版12G-SDI。         SD-SDI很少有人用,我怀疑可能是640x512的说法,270Mb/s的数据传输量         HD-SDI最常遇

    2024年02月06日
    浏览(40)
  • 基于FPGA的视频接口之高速IO(光纤)

            对于高速IO口配置光纤,现在目前大部分开发板都有配置,且也有说明,在此根据自己的工作经验以及对于各开发板的说明归纳         通过高速IO接口,以及硬件配置,可以实现对于光纤的收发功能,由于GTX的速率在500Mbs到10Gbps之间,但通道高速io可配置光纤10G硬件

    2024年02月21日
    浏览(41)

觉得文章有用就打赏一下文章作者

支付宝扫一扫打赏

博客赞助

微信扫一扫打赏

请作者喝杯咖啡吧~博客赞助

支付宝扫一扫领取红包,优惠每天领

二维码1

领取红包

二维码2

领红包